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一种适于GNSS信号快捕的FFT核的设计与实现
来源：宇航计测技术,2013,33(3):28-33
上传时间：2016-01-27
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针对GNSS信号捕获的要求，在Quartus II 7.2 集成开发环境下，采用Verilog HDL 语言，设计了一种256 点复数基2时间抽取FFT处理器。利用Matlab 工具联合Quartus II 进行仿真，提高仿真效率，并最后进行硬件测试。结果表明，本文设计的FFT 处理器具有较小的面积和较高的处理速度，能够满足GNSS 接收机信号处理的要求。
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